Cirrus-logic CS4365 Uživatelský manuál Strana 44

  • Stažení
  • Přidat do mých příruček
  • Tisk
  • Strana
    / 52
  • Tabulka s obsahem
  • KNIHY
  • Hodnocené. / 5. Na základě hodnocení zákazníků
Zobrazit stránku 43
44 DS670F2
CS4365
6.12 PCM Clock Mode (address 16h)
6.12.1 Master Clock DIVIDE by 2 ENABLE (MCLKDIV)
Function:
When set to 1, the MCLKDIV bit enables a circuit which divides the externally applied MCLK signal by 2
prior to all other internal circuitry.
When set to 0 (default), MCLK is unchanged.
76543210
Reserved Reserved MCLKDIV Reserved Reserved Reserved Reserved Reserved
00000000
Zobrazit stránku 43
1 2 ... 39 40 41 42 43 44 45 46 47 48 49 50 51 52

Komentáře k této Příručce

Žádné komentáře